S5443_V3/sources_1/new/ClkManager/SpiClkMux.v

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// Company:         TAIR
// Engineer:        
// 
// Create Date:     10/30/2023 11:24:31 AM
// Design Name:
// Module Name:     SpiClkMux
// Project Name:    S5443_V3_FPGA3
// Target Devices:  BOARD: BY5443v3. FPGA: xc7s25csga225-2
// Tool Versions:
// Description:     This module muxes clock based on a clkCh signal - MMCM or 
//					from a custom divider.
// 
// Dependencies: 
// 
// Revision:
// Revision 1.0 - File Created
// Additional Comments:
// 
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module SpiClkMux (
	input Rst_i,
	input clkCh,
	input clkOutMMCM,
	input clkMan,

	output SpiClk_o
);
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//	REG/WIRE
//================================================================================
reg spiClkReg;

wire spiClk;

//================================================================================
//	ASSIGNMENTS
//===============================================================================
assign spiClk = spiClkReg;

//================================================================================
//	CODING
//================================================================================ 
// always @(*) begin 
// 	if (Rst_i) begin 
// 		spiClkReg = 0;
// 	end
// 	else begin 
// 		if (clkCh) begin 
// 			spiClkReg = clkOutMMCM;
// 		end
// 		else begin 
// 			spiClkReg = clkMan;
// 		end
// 	end
// end

// BUFG BUFG_inst (
// 	.O(SpiClk_o),	// 1-bit output: Clock output
// 	.I(spiClk)		// 1-bit input: Clock input
// );

   BUFGMUX #(
   )
   BUFGMUX_inst (
      .O(SpiClk_o),   // 1-bit output: Clock output
      .I0(clkMan), // 1-bit input: Clock input (S=0)
      .I1(clkOutMMCM), // 1-bit input: Clock input (S=1)
      .S(clkCh)    // 1-bit input: Clock select
   );

endmodule