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@@ -18,7 +18,6 @@
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module Gpio1Ctrl (
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module Gpio1Ctrl (
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input Clk_i,
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input Clk_i,
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- input Rst_i,
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input ValGpioDataToFifo_i,
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input ValGpioDataToFifo_i,
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input [23:0] Data_i,
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input [23:0] Data_i,
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@@ -29,11 +28,8 @@ module Gpio1Ctrl (
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output reg [21:0] GpioReg_o
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output reg [21:0] GpioReg_o
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);
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);
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-always @(posedge Clk_i) begin
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- if(Rst_i) begin
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- GpioReg_o <= 0;
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- end
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- else if (ValGpioDataToFifo_i || (FlagDirectGpio1_i && ValDataFromSpi_i)) begin
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+always @(posedge Clk_i) begin
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+ if (ValGpioDataToFifo_i || (FlagDirectGpio1_i && ValDataFromSpi_i)) begin
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GpioReg_o <= Data_i[21:0];
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GpioReg_o <= Data_i[21:0];
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end
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end
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end
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end
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